基于FPGA的模块化联网实验箱系统的设计与实现-.docx
《基于FPGA的模块化联网实验箱系统的设计与实现-.docx》由会员分享,可在线阅读,更多相关《基于FPGA的模块化联网实验箱系统的设计与实现-.docx(9页珍藏版)》请在淘文阁 - 分享文档赚钱的网站上搜索。
1、基于FPGA的模块化联网实验箱系统的设计与实现* 企业选购的。该类平台的结构往往固定,而且采纳的导线连接直插式电子元器件方式,存在分立元件过多导致电路结构杂乱无章、错误频现的弊端,造成试验内容更新慢、实际利用率低,难以满意学生日益增长的创新性试验需求。这在很大程度上制约着学生专业实力的巩固和提高。 此外,随着近年来物联网的兴起,试验室物联信息化已成为试验教学改革的必定趋势。从提高试验教学效率、实现信息化改革的角度动身,本文设计实现了一种具备物联特性的基于FPGA的模块化联网试验箱系统。它依托可编程器件和IIC总线通信技术,采纳模块化设计,兼容多种试验电路单元,与互联网结合形成一个巨大的网络,供
2、应功能可变、远程可控、虚实结合的试验平台,提升设备的通用性和更新速度,提高学生的试验效率,提高教学质量。 1 试验箱系统的总体设计 在试验教学物联化改革的趋势中,基于FPGA的模块化联网试验箱系统首先要解决的问题是设备通信。对于试验箱系统与测量仪器及客户端之间的通信,采纳网口通信的方式更加合适,以ARM单片机为通信核心,通过串口转网口模块,实现试验箱系统的网络接入,便于用户对试验箱的操作以及波形数据测量;对于试验箱系统内部的通信,在众多的通信方式中,IIC总线作为一种精彩的通信方式,资源成本极低,而且信息传输速率相对较高,具备多从机挂载实力。因此,采纳IIC总线进行系统内部通信,便于FPGA对
3、于试验电路模块的管理和限制。 另外一个须要解决的问题是试验内容的更新。基于FPGA的模块化联网试验箱系统采纳模块化设计,依托IIC总线连接多个可插拔的电路模块,在无需改动限制单元的状况下,敏捷动态地搭建试验电路。此外,可以依据学生在不同阶段不同层次的学习需求,采纳更换电路模块的方式进行试验内容的更新,充分满意创新性试验须要。 当然,试验箱系统还须要包括处理模块、电源模块、编程下载口模块和信号输入/输出模块,加上之前的通信模块、总线限制模块和电路模块三个模块,共七个部分。系统采纳星形拓扑结构,通过电源模块供应功能保障,以单片机和FPGA协同的处理模块为核心,向周边辐射绽开各功能模块,实现试验箱系
4、统的物联与重构功能。试验箱系统结构如图1所示。 2 单元模块设计 依据系统总体设计,基于FPGA的模块化联网试验箱系统集成多种功能,采纳双层结构,下层为试验箱底板,上层为各功能模块,包括处理模块、电源模块、通信模块、总线限制模块、编程下载口模块、信号输入/输出模块和电路模块。图2为试验箱示意图。 2.1 处理模块设计 试验箱系统借鉴片上系统的思想,采纳单片机与FPGA协同工作的方式,充分发挥FPGA的资源优势以及ARM微处理器的低成本、低功耗和高性能,用 ARM单片机实现试验箱系统与网络的信息通信,用FPGA完整限制内部系统,两者之间采纳一组I/O口进行并行数据通信。其中,FPGA处理单元采纳
5、Xilinx的Spartan XC3S50,作为5万门级 的可编程芯片,加上144个I/O口,其性价比高、处理速度快,完全可以满意电工电子试验教学的基本需求以及学生的创新性试验需求;单片机处理单元采纳的是STM32F103VE,其采纳的ARM CORTEX-M3的内核和32位精简指令集,成本低,性能优异,在73M的工作频率下,具备较高的处理速度和较强的处理实力,可以进行较高速的数据通信和处理。 2.2 电源模块设计 试验箱系统主要用到的是+1.2 V、+3.3 V和5 V,其中,+1.2 V和+3.3 V分别为FPGA芯片的内核与I/O口供电,运用5 V给各模块器件供电。1.2 V电源电路如图
6、3所示。 详细做法如下:采纳XL2576S降压型开关稳压器,将由外部输入的1240 V电压信号进行降压并稳定输出5 V;将5 V电压作为输入信号,通过AMS1117-3.3电源芯片降压至所需的3.3 V;以3.3 V电压作为输入信号,通过AMS1117-1.2电源芯片来获得1.2 V的目标电压。此外,考虑到电源正负极反接的可能,在信号输入端采纳最大反相电压为45 V的1N5817二极管超过了学生直流电源的最大输出电压,充分爱护电源模块及试验箱系统。3.3 V纹波抑制电源电路如图4所示。 由于系统中的各功能模块对电压值具有较高的要求,因此,如图4所示,可以在输出端外接成排接地电容,有效地滤除纹波
7、,提高电源质量,给整个物联化试验箱系统供应纹波较小的工作电压。 2.3 通信模块设计 通信作为必不行少的一部分,其主要由两部分组成,分别为RS232串口单元和网口转串口单元。通信模块与处理模块连接,其中主要是采纳ARM处理核心来进行数据的传输和处理的。RS232串口单元用于终端客户机与试验箱进行有线数据传输,在9 600波特率的速率下进行信息交互。网口单元主要由串口转以太网模块构成,模块集成 10/101M 自适应以太网接口,最高波特率256 Kbps。将终端客户配置为TCP Client工作模式,试验箱配置为TCP Server,采纳用户/服务器的工作方式,实现试验箱与客户终端之间的数据传输
- 配套讲稿:
如PPT文件的首页显示word图标,表示该PPT已包含配套word讲稿。双击word图标可打开word文档。
- 特殊限制:
部分文档作品中含有的国旗、国徽等图片,仅作为作品整体效果示例展示,禁止商用。设计者仅对作品中独创性部分享有著作权。
- 关 键 词:
- 基于 FPGA 模块化 联网 实验 系统 设计 实现
限制150内